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龙图腾网获悉中国电子科技集团公司第五十八研究所申请的专利一种加速芯片中长走线建立时间的电路获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN116015278B 。

龙图腾网通过国家知识产权局官网在2026-05-12发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202211673362.8，技术领域涉及：H03K19/094；该发明授权一种加速芯片中长走线建立时间的电路是由张保侠;朱琪;肖培磊设计研发完成，并于2022-12-26向国家知识产权局提交的专利申请。

本一种加速芯片中长走线建立时间的电路在说明书摘要公布了：本发明公开一种加速芯片中长走线建立时间的电路，属于集成电路领域，包括前级BUFFER电路、后级KEEPER电路、第一MOS器件、第二MOS器件；BUFFER电路和KEEPER电路相串联。BUFFER电路包括串联的第一反相器和第二反相器，KEEPER电路包括串联的第三反相器和第六反相器；第二反相器的输出端通过信号线连接至第三反相器的输入端。第二MOS器件的源极端连接GND信号，漏极端连接第六反相器内部NMOS的源极端；第一MOS器件的源极端连接Vcc信号，漏极端连接第六反相器内部PMOS的源极端；第一MOS器件的栅极端与第二MOS器件的栅极端分别连接单独供给的使能信号。本发明通过增加2个开关MOS管，消除KEEPER电路内部信号线上前一状态对信号线上信号建立时间的冲突影响，简单易操作，且节省版图面积和成本。

本发明授权一种加速芯片中长走线建立时间的电路在权利要求书中公布了：1.一种加速芯片中长走线建立时间的电路，其特征在于，包括前级BUFFER电路、后级KEEPER电路，以及第一MOS器件、第二MOS器件；其中所述BUFFER电路和所述KEEPER电路相串联； 所述BUFFER电路包括第一反相器和第二反相器，所述第一反相器的输入端接输入信号INPUT，输出端连接第二反相器的输入端； 所述KEEPER电路包括第三反相器和第六反相器，所述第三反相器的输出端连接第六反相器的输入端，所述第三反相器的输出端即为整个电路的输出端；所述第六反相器的输出端反馈连接至所述第三反相器的输入端，实现对所述第三反相器输入端的信号加强； 所述BUFFER电路的输出端，即所述第二反相器的输出端，通过第一信号线连接至所述KEEPER电路的输入端，即所述第三反相器的输入端； 所述第二MOS器件的源极端连接GND信号，漏极端连接第六反相器内部NMOS的源极端；所述第一MOS器件的源极端连接Vcc信号，漏极端连接第六反相器内部PMOS的源极端；所述第一MOS器件的栅极端与所述第二MOS器件的栅极端分别连接单独供给的使能信号； 所述第二MOS器件的栅极端连接enable信号，所述第一MOS器件的栅极端连接enable_B信号；所述enable信号与所述enable_B信号反相，即两者不能同时打开； 所述第一MOS器件为PMOS管，所述第二MOS器件为NMOS管； 所述第二MOS器件的栅极端连接enable信号，所述第一MOS器件的栅极端连接enable_B信号；所述enable信号与所述enable_B信号反相，两者不能同时打开； 当输入信号INPUT水平为“1”时，经过BUFFER电路后，信号水平维持为“1”，后经过第一信号线，大的RC负载致使其传输至KEEPER电路时需要时间，在第一信号线上的电压水平升至第三反相器内部NMOS的阈值电压Vth之前，第二信号线上的信号水平维持为“1”，再经过第六反相器，反馈至第一信号线的信号水平为“0”，而第一信号线是需要尽快拉高至Vth之上，Vth是第三反相器内部NMOS的阈值电压，整个电路才能正常工作；通过第二MOS器件的源极端连接地GND，漏极端连接第六反相器内部NMOS的源极端，在第一信号线上的电压水平升至第三反相器内部NMOS的阈值电压Vth之前，第二MOS器件的栅极端设置为低电平，关断第六反相器的反馈信号输出，屏蔽第二信号线上的前一状态的信号水平对反馈信号带来的影响；当第一信号线上的电压水平升高至阈值电压Vth时，第二MOS器件的栅极端设置为高电平，此时第二信号线上的信号水平为“0”，经过第六反相器后，反馈至第一信号线的电压水平变为“1”，起到加速第一信号线上的电压水平的作用，加速第一信号线上的信号建立时间；反之，当输入信号INPUT水平为“0”时，经过BUFFER电路后，信号水平维持为“0”，后经过第一信号线，大的RC负载致使其传输至KEEPER电路时需要时间，在第一信号线上的电压水平从上一状态“1”降至第三反相器内部PMOS的阈值电压Vth之前，第二信号线上的信号水平维持为“0”，再经过第六反相器，输出反馈给第一信号线的信号水平为“1”，而第一信号线是需要尽快降低至阈值电压Vth之下，整个电路才能正常工作，通过第一MOS器件的源极端连接地GND，漏极端连接第六反相器内部PMOS的源极端，第一MOS器件的栅极端设置为高电平，关断第六反相器的反馈信号输出，屏蔽第二信号线上的前一状态的信号水平对反馈信号带来的影响；当第一信号线上的电压水平降低至阈值电压Vth时，第一MOS器件的栅极端设置为低电平，此时第二信号线上的信号水平为“1”，经过第六反相器后，反馈至第一信号线上的电压水平变为“0”，起到加速第一信号线上的电压水平的作用，加速第一信号线上的信号建立时间； 其中，第一信号线为第二反相器和第三反相器之间的信号线，第二信号线为第三反相器和第六反相器之间的信号线。

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