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龙图腾网获悉郑州信大捷安信息技术股份有限公司申请的专利任意地址PCIE DMA读写实现方法、设备及系统获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN115525589B 。

龙图腾网通过国家知识产权局官网在2026-04-21发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202210293600.6，技术领域涉及：G06F13/28；该发明授权任意地址PCIE DMA读写实现方法、设备及系统是由苏庆会;冯驰;李银龙;王斌;王中原;王凯霖;刘苗苗设计研发完成，并于2022-03-24向国家知识产权局提交的专利申请。

本任意地址PCIE DMA读写实现方法、设备及系统在说明书摘要公布了：发明提出了一种任意地址PCIEDMA读写实现方法、设备及系统，所述方法包括以下步骤：FPGA根据起始地址和长度信息以DW为单位封装出多个TLP读请求包发送给PCIEIPCORE，并将有效信息记录下来；在数据接收模块收到TLP读完成包时，先将TLP读完成包的数据缓存到FIFO中，再根据缓存的有效信息将接收数据从缓存FIFO中读取出来，对接收数据进行调整，最后将完整连续的有效数据发送给下游模块，完成DMA读操作。本发明能够实现获取任意地址内存数据或向任意地址内存写数据。

本发明授权任意地址PCIE DMA读写实现方法、设备及系统在权利要求书中公布了：1.一种任意地址PCIEDMA读写实现方法，其特征在于，包括以下步骤： 步骤1，在FPGA的状态字cmd_fifo中，写入内存空间Ⅰ的起始地址和待处理数据长度； 其中，所述内存空间Ⅰ的起始地址和所述待处理数据长度均由主机通过PIO模式发送给FPGA，所述内存空间Ⅰ为主机申请的一段用于存放待处理数据的连续内存空间； 步骤2，FPGA的DMA读控制模块在查询到状态字cmd_fifo不为空时，根据起始地址和待处理数据长度计算出字节使能信号，并按预设规则以DW为单位封装出N个TLP读请求包，并将本次DMA读操作的起始地址和待处理数据长度缓存到状态字DMA_FIFO中； 其中，每个TLP读请求包均包括字节使能信号、请求数据大小、请求起始地址和读请求标签； 步骤3，FPGA的数据发送模块Ⅰ将所述TLP读请求包经PCIEIPCORE发送给PCIE根联合体RC，以访问主机内存； 步骤4，FPGA的DMA读控制模块在本次DMA读操作的TLP读请求包全部发送完成时，将发送的每个TLP读请求包中的请求数据大小和读请求标签依次缓存到状态字TAG_FIFO中； 步骤5，FPGA的数据接收模块在接收到TLP读完成包时，解析出TLP读完成包的负载数据、DW有效信号和读完成标签，根据所述读完成标签将TLP读完成包的DW有效信号和负载数据发送给对应的写FIFO控制模块； 其中，所述读完成标签与步骤4中的读请求标签一一对应； 步骤6，FPGA的写FIFO控制模块，将所述负载数据以DW为单位连续地写入到后端的第一数据缓存FIFO中； FPGA的数据接收模块在检测到某个读完成标签对应的TLP读完成包接收完成后，生成对应的接收完成标识符，并发送至FPGA的读FIFO控制模块； 步骤7，所述读FIFO控制模块，在接收到所有读完成标签对应的接收完成标识符后，根据获取到的读完成标签顺序循环读取对应的第一数据缓存FIFO中的负载数据，并根据状态字DMA_FIFO中获取的起始地址和待处理数据长度，对读取到的负载数据进行排序处理，删除第一个DW和或最后一个DW中的冗余数据。

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