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龙图腾网获悉上海高性能集成电路设计中心申请的专利一种基于单端电压灵敏放大器结构的多端口寄存器堆获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN114153497B 。

龙图腾网通过国家知识产权局官网在2026-04-21发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202111439842.3，技术领域涉及：G06F9/30；该发明授权一种基于单端电压灵敏放大器结构的多端口寄存器堆是由方华;赵信设计研发完成，并于2021-11-30向国家知识产权局提交的专利申请。

本一种基于单端电压灵敏放大器结构的多端口寄存器堆在说明书摘要公布了：本发明涉及一种基于单端电压灵敏放大器结构的多端口寄存器堆，包括：存储单元阵列、读地址译码器、写地址译码器、读数据通路和写数据通路；所述存储单元阵列由交叉耦合反相器对构成存储节点，同时具备多个写端口和多个读端口；所述读地址译码器和写地址译码器均采用全静态逻辑实现；所述读数据通路采用单端电压灵敏放大器和RS锁存器结构实现读操作；所述写数据通路采用分割写位线的方式进行写数据的分块驱动。本发明提升了性能的同时降低了动态功耗。

本发明授权一种基于单端电压灵敏放大器结构的多端口寄存器堆在权利要求书中公布了：1.一种基于单端电压灵敏放大器结构的多端口寄存器堆，其特征在于，包括：存储单元阵列、读地址译码器、写地址译码器、读数据通路和写数据通路；所述存储单元阵列由交叉耦合反相器对构成存储节点，同时具备多个写端口和多个读端口；所述读地址译码器和写地址译码器均采用全静态逻辑实现；所述读数据通路采用单端电压灵敏放大器和RS锁存器结构实现读操作，通过放大摆幅信号达到快速读出有效数据的目的；所述写数据通路采用分割写位线的方式进行写数据的分块驱动； 所述读地址译码器包含：动态差分读地址生成模块、动态读使能窄脉宽生成模块、静态逻辑全译码模块、预充时钟和放大器使能生成模块；所述动态差分读地址生成模块通过正沿时钟门控Latch生成差分动态地址信号，用于后续读地址译码；所述动态读使能窄脉宽生成模块通过正沿时钟门控Latch生成动态读使能，并经过脉冲信号生成器生成窄脉宽读使能，参与后续读地址译码；所述静态逻辑全译码模块将差分动态地址信号和窄脉宽读使能经过静态逻辑完成全译码，最终生成窄脉宽读字线，开启任意一个条目，进行存储阵列的读操作；所述预充时钟和放大器使能生成模块将输入读使能通过正沿时钟门控Latch生成预充信号，所述预充信号通过延时门控单元生成灵敏放大器使能信号。

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